大连理工大学23秋《数字电路与系统》在线作业二

奥鹏大连理工大学23年秋季新学期作业参考

大工23秋《数字电路与系统》在线作业2-00001

74LS175是（）位集成寄存器。
A:四
B:三
C:二
D:一
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全加器与半加器相比，根本区别在于？（）
A:全加器考虑了加数
B:全加器考虑了被加数
C:全加器输入端考虑了来自低位的进位
D:其它选项都不正确
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两个二进制数之间的算术运算的实现在数字计算机中都是化成若干步（）进行运算的。
A:加法
B:减法
C:乘法
D:除法
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译码器通常是一个（）的组合逻辑电路。
A:单输入单输出
B:单输入多输出
C:多输入单输出
D:多输入多输出
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在实际应用中，可能出现多个输入信号同时有效的情况，这时，编码器要决定哪个输入有效，这可以通过（）来实现。
A:二进制编码器
B:二-十进制编码器
C:普通编码器
D:优先编码器
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在数字电路中，凡根据输入信号R、S情况的不同，具有置0、置1和保持功能的电路，都称为（）。
A:JK触发器
B:D触发器
C:T触发器
D:奥鹏大连理工大学23年秋季新学期作业参考RS触发器
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时序逻辑电路要想完全描述功能，必须要有下列哪些方程？（）
A:特性方程
B:激励方程
C:状态方程
D:输出方程
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下列哪些是触发器的典型应用？（）
A:消除噪声电路
B:移位寄存器
C:数据锁存器
D:单脉冲发生器
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下列哪些是译码器74138的特点？（）
A:有三个输入端
B:有四个输入端
C:有八个输出端
D:有十六个输出端
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组合逻辑电路中，用下列哪些来代表不同的状态？（）
A:0
B:1
C:2
D:3
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序列信号发生器可以由（）构成。
A:计数器
B:移位寄存器
C:数据比较器
D:加法器
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时序逻辑电路的信号与下列哪些因素有关？（）
A:当时的输入信号
B:以前的状态
C:以前的输入信号
D:初始状态
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主从RS触发器的状态在每个CLK脉冲期间里可以变化多次。
A:错误
B:正确
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画主从JK触发器的时序波形图时，如果不考虑门的时延，则异步置1端和异步置0端可以直接确定触发器的状态，与时钟信号无关。
A:错误
B:正确
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主从JK触发器只适合于CLK窄脉冲触发。
A:错误
B:正确
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逻辑函数表达式不能用来描述触发器的逻辑功能。
A:错误
B:正确
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同步计数器有外部输入变量。
A:错误
B:正确
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算术运算是数字系统的基本功能之一。
A:错误
B:正确
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同步时序逻辑电路的设计中给定的原始状态图一般都是最简的。
A:错误
B:正确
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同步时序逻辑电路的状态方程就是相应触发器的次态方程。
A:错误
B:正确
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