华师大《数字逻辑》在线作业

奥鹏华中师范大学平时在线作业

华师《数字逻辑》在线作业-0004

题面见图片：
A:选择图中A选项
B:选择图中B选项
C:选择图中C选项
D:选择图中D选项
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和二进制数(1100110111.001)等值的十六进制数学是( )。
A:337.2
B:637.2
C:1467.1
D:c37.4
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设计一个五位二进制码的奇偶位发生器，需要（ ）个异或门
A:2
B:3
C:4
D:5
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A:A
B:B
C:C
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下列逻辑门中，（ ）不属于通用逻辑门
A:与非门
B:或非门
C:或门
D:与或非门
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实现两个4位二进制数相乘的组合电路，其输入输出端个数应为（ ）
A:4入4出
B:8入8出
C:8入4出
D:8入5出
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和二进制码1100对应的格雷码是（ ）
A:0011
B:1100
C:1010
D:0101
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完全确定原始状态表中的五个状态A、B、C、D、E，若有等效对A和B，B和D，C和E，则最简状态表中只含（ ）个状态
A:2
B:3
C:1
D:4
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电平异步时序逻辑电路不允许两个或两个以上输入信号（ ）
A:同时为0
B:同时为1
C:同时改变
D:同时出现
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主从触发器的触发方式是（ ）
A:CP=1
B:CP上升沿
C:CP下降沿
D:分两次处理
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欲对全班53个同学以二进制代码编码表示，最少需要二进制的位数是( )
A:5
B:6
C:10
D:53
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是8421BCD码的是（ ）
A:1010
B:0101
C:1100
D:1111
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以下哪一条不是消除竟争冒险的措施（ ）
A:接入滤波电路
B:利用触发器
C:加入选通脉冲
D:修改逻辑设计
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下列触发器中，（ ）不可作为同步时序逻辑电路的存储元件。
A:基本R-S触发器
B:D触发器
C:J-K触发器
D:T触发器
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相同计数模的异步计数器和同步计数器相比，一般情况下（ ）
A:驱动方程简单
B:使用触发器的个数少
C:工作速度快
D:其他选项都选
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用PLA进行逻辑设计时，应将逻辑函数表达式变换成（ ）
A:异或表达式
B:与非表达式
C:最简“与—或”表达式
D:标准“或—与”表达式
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一个T触发器，在T=1时，来一个时钟脉冲后，则触发器( )。
A:保持原态
B:置0
C:置1
D:翻转
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一块数据选择器有三个地址输入端，则它的数据输入端应有（ ）。
A:3
B:6
C:8
D:1
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EPROM是指（ ）
A:随机读写存储器
B:只读存储器
C:可擦可编程只读存储器
D:电可擦可编程只读存储器
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用ROM实现四位二进制码到四位循环码的转换，要求存储器的容量为（ ）。
A:8
B:16
C:32
D:64
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PROM、PLA、和PAL三种可编程器件中，（ ）是不能编程的
A:PROM的或门阵列
B:PAL的与门阵列
C:PLA的与门阵列和或门阵列
D:PROM的与门阵列
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组合逻辑电路中的险象是由于（ ）引起的
A:电路未达到最简
B:电路有多个输出
C:电路中的时延
D:逻辑门类型不同
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一片四位二进制译码器，它的输出函数有（ ）
A:1个
B:8个
C:10个
D:16个
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A:A
B:B
C:C
D:D
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实现同一功能的Mealy型同步时序电路比Moore型同步时序电路所需要的（ ）
A:状态数目更多
B:状态数目更少
C:触发器更多
D:触发器一定更少
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下列说法中，（ ）不是逻辑函数的表示方法。
A:真值表和逻辑表达式
B:卡诺图和逻辑图
C:波形图和状态图
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构造一个模10同步计数器，需要（ ）触发器
A:3个
B:4个
C:5个
D:10个
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余3码10001000对应2421码为（ ）
A:01010101
B:10000101
C:10111011
D:11101011
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若干个具有三态输出的电路输出端接到一点工作时，必须保证（ ）
A:任何时候最多只能有一个电路处于三态，其余应处于工作态。
B:任何时候最多只能有一个电路处于工作奥鹏华中师范大学平时在线作业态，其余应处于三态。
C:任何时候至少要有两个或三个以上电路处于工作态。
D:其他选项都选
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同步时序电路设计中，状态编码采用相邻编码法的目的是（ ）
A:减少电路中的触发器
B:提高电路速度
C:提高电路可靠性
D:减少电路中的逻辑门
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脉冲异步时序逻辑电路中的存储元件可以采用（ ）
A:时钟控制RS触发器
B:D触发器
C:基本RS触发器
D:JK触发器
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寄存器传送操作包括
(

).
A:信息读入
B:信息输出
C:信息加工
D:信息存储
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余
3BCD
码的特点是
(

)
A:当作二进制码看比等值的
8421BCD
码多
3
B:是一种有权码
C:按二进制进行加法时自动解决了进位问题
D:具有逻辑相邻性
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下列中规模通用集成电路中，（ ）属于组合逻辑电路
A:4位计数器T4193
B:4位并行加法器T693
C:4位寄存器T1194
D:4位数据选择器T580
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二进制并行加法器的主要功能有( )
A:二进制加法运算
B:代码转换
C:十进制加法运算
D:二进制减法运算
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数字系统中，采用（ ）可以将减法运算转化为加法运算
A:原码
B:补码
C:Gray码
D:反码
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PLD器件的基本结构组成有(

)
。
A:与阵列
B:或阵列
C:输入缓冲电路
D:输出电路
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可重复进行编程的可编程器件有( )
A:PAL
B:GAL
C:PROM
D:ISP-PLD
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